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enum | vsf_adc_mode_t {
VSF_ADC_REF_VDD_1 = (0 << 0)
,
VSF_ADC_REF_VDD_1_2 = (1 << 0)
,
VSF_ADC_REF_VDD_1_3 = (2 << 0)
,
VSF_ADC_REF_VDD_1_4 = (3 << 0)
,
VSF_ADC_DATA_ALIGN_RIGHT = (0 << 2)
,
VSF_ADC_DATA_ALIGN_LEFT = (1 << 2)
,
VSF_ADC_SCAN_CONV_SINGLE_MODE = (0 << 3)
,
VSF_ADC_SCAN_CONV_SEQUENCE_MODE = (1 << 3)
,
VSF_ADC_EXTERN_TRIGGER_0 = (0 << 4)
,
VSF_ADC_EXTERN_TRIGGER_1 = (1 << 4)
,
VSF_ADC_EXTERN_TRIGGER_2 = (2 << 4)
} |
|
enum | vsf_adc_irq_mask_t { VSF_ADC_IRQ_MASK_CPL = (0x1ul << 0)
} |
|
◆ __HAL_DRIVER_
#define __HAL_DRIVER_ ${SERIES/ADC_IP}_ADC_H__ |
◆ VSF_
◆ VSF_ADC_CFG_REIMPLEMENT_TYPE_MODE
#define VSF_ADC_CFG_REIMPLEMENT_TYPE_MODE ENABLED |
◆ VSF_ADC_CFG_REIMPLEMENT_TYPE_STATUS
#define VSF_ADC_CFG_REIMPLEMENT_TYPE_STATUS ENABLED |
◆ VSF_ADC_CFG_REIMPLEMENT_TYPE_IRQ_MASK
#define VSF_ADC_CFG_REIMPLEMENT_TYPE_IRQ_MASK ENABLED |
◆ VSF_ADC_CFG_REIMPLEMENT_TYPE_CFG
#define VSF_ADC_CFG_REIMPLEMENT_TYPE_CFG ENABLED |
◆ VSF_ADC_CFG_REIMPLEMENT_TYPE_CAPABILITY
#define VSF_ADC_CFG_REIMPLEMENT_TYPE_CAPABILITY ENABLED |
◆ vsf_adc_mode_t
◆ vsf_adc_irq_mask_t
◆ vsf_adc_status_t
◆ vsf_adc_t
◆ vsf_adc_isr_handler_t
◆ vsf_adc_isr_t
◆ vsf_adc_cfg_t
◆ vsf_adc_capability_t
◆ vsf_adc_mode_t
Enumerator |
---|
VSF_ADC_REF_VDD_1 | |
VSF_ADC_REF_VDD_1_2 | |
VSF_ADC_REF_VDD_1_3 | |
VSF_ADC_REF_VDD_1_4 | |
VSF_ADC_DATA_ALIGN_RIGHT | |
VSF_ADC_DATA_ALIGN_LEFT | |
VSF_ADC_SCAN_CONV_SINGLE_MODE | |
VSF_ADC_SCAN_CONV_SEQUENCE_MODE | |
VSF_ADC_EXTERN_TRIGGER_0 | |
VSF_ADC_EXTERN_TRIGGER_1 | |
VSF_ADC_EXTERN_TRIGGER_2 | |
◆ vsf_adc_irq_mask_t
Enumerator |
---|
VSF_ADC_IRQ_MASK_CPL | |
◆ reg
◆ isr